任職要求: 1、教育背景:電子工程、計算機科學、通信工程等相關專業(yè)本科及以上學歷。 2、專業(yè)技能:熟悉Verilog或SystemVerilog語言,具備FPGA開發(fā)經驗,了解Xilinx或者Altera主流FPGA開發(fā)工具;熟練掌握Modelsim或者其他仿真工具 3、圖像處理經驗:具備圖像處理、機器視覺相關經驗者優(yōu)先。 4、硬件知識:了解硬件電路設計與調試,具備一定的硬件基礎知識。 5、編程技能:熟悉C/C 、Python等編程語言,具備一定的軟件開發(fā)能力。 6、問題解決能力:具備良好的問題分析與解決能力,能夠獨立完成任務。 7、團隊合作:具備良好的溝通能力和團隊合作精神,能夠與其他工程師協(xié)作完成項目。



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機械制造·機電·重工
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